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基于DSP与双目CMOS摄像头的数字图像处理系统

发布时间:2019-06-16 08:15 来源:未知 编辑:admin

  传统的数字图像处理通常采用图像采集卡,将模拟电视信号转换成数字信号,然后由pc机进行软处理。这样不仅不够灵活,处理能力也受到pc机和软件的限制。随着cmos成像芯片工艺的改进和数字信号处理器功能的提升,使得数据量与计算量较大的图像硬处理成为可能。本文详细介绍了通过两路cmos摄像头采集图像,以浮点dsp为核心处理器,采用60万门fpga实现逻辑控制的数字图像采集处理系统的设计原理和实现方法。本系统所采用的芯片与器件,在保证性能的同时,兼顾低功耗,整个系统可以由1394线缆供电。

  整个系统的原理框图如图1所示。系统上电后,fpga配置子板把配置文件加载到fpga中。dsp由外部 flash引导,通过fpga先设置1394接口芯片的内部寄存器,再通过i2c总线的控制寄存器。fpga提供摄像头的工作时序和图像序列的读写时序。云台在dsp的控制下可以上下左右调整,捕捉感兴趣的目标。8片1mb的sram作为两路摄像头的数据存储器,16mb的sdram则充当dsp的外部数据缓冲。处理后的图像既可以直接输出至lcd进行显示,也可以通过1394总线系统设计

  摄像头采用韩国现代的hv7131r和五层玻璃透镜。hv7131r采用0.3μm的cmos工艺,有效像素30万,功耗低于90mw,具有曝光控制、增益控制和白平衡处理等功能,最大帧率30fps@vga。通过标准的i2c接口设置hv7131r的内部寄存器,可以调节图像的曝光时间、分辨率、帧率、rgb增益、镜像等。hv7131r输出10位的rgb原始数据,本系统采用了其中的高8位。多层玻璃透镜可以滤除波长大于630nm的红外线,并采用超焦距对焦方式,最小成像距离为3cm。

  考虑到运动图像处理至少需要3帧的序列图像,每组摄像头配备了4片ram。3片做数据采集缓冲,1片存储dsp处理后的结果。

  基于以上要求,本系统采用ti公司的32位浮点dsp tms320c6711b。6711b采用改进的哈佛总线mhz,内部集成硬件乘法器和累加器,采用流水线velocititm甚长指令字(vliw)指令,具有丰富的片上外设,并有专门针对数字信号处理的指令系统,运算能力可达1200mflops,适用于计算量大、实时性高的数字图像处理领域。fpga 则采用altera公司apex系列的ep20k600ebc652。ep20k600ebc652具有高速度(622mhz的数据速率)、高密度(有效逻辑60万门)、低噪声和低功耗的特点。有4个pll、480个低电压差分信号(lvds)的i/o口,工作电压为2.5v和1.8v。

  运动目标检测与跟踪、目标的识别与提取等基于图像内容的处理,对图像质量要求较高。影响成像质量的两个重要因素为曝光和白平衡:人眼对外部环境的明暗变化非常敏感,在强光环境下,瞳孔缩小,使得景物不那么刺眼;而光线较弱时,瞳孔扩大,使景物尽可能地变清楚。这在成像中,称为曝光。当外界光线较弱时,cmos成像芯片工作电流较小,所成图像偏暗,这时要适当增加曝光时间进行背光补偿;光线充足或较强时,要适当减少曝光时间,防止曝光过度,图像发白。改善成像质量,仅靠调节曝光时间是不够的。因为物体颜色会随照射光线的颜色发生改变,在不同的光线场合图像有不同的色温。这就是白平衡问题。传统光学相机或摄像机通过给镜头加滤镜消除图像的偏色现象。对于cmos成像芯片,可以通过调整rgb三基色的电子增益解决白平衡问题。

  本系统为了便于调试,pc机被设定为根节点控制器,应用程序和硬件通过驱动程序进行交互。win32应用程序通过设备驱动程序、总线驱动程序、端口驱动程序与1394设备进行通信,如图5所示。

  其中,1394总线驱动程序和端口驱动程序处理所有繁琐的底层通信,只需提供设备驱动程序。llc和plc的内部寄存器通过6711b设置,设备的发现与识别、驱动程序的安装、1394总线b的控制和响应。

  本系统图像的最大数据量为640×480×30×2=18.4mbps,1394a最高支持400mbps的传输速率,图像实时传输不需要经过压缩。实际传输过程中,为确保每帧图像的完整,采用异步传输模式,图像序列之间加入了帧同步信号,使带宽利用率有所下降,最终的实测速率为。该系统采用32位浮点dsp和大容量、多i/o口的高速fpga,数据处理能力强,电路设计灵活,为今后运动目标检测与跟踪算法的研究提供了软硬件支持。

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